El centro de investigación IMEC ha revelado una hoja de ruta que detalla cómo la industria superará la barrera del nanómetro, proyectando una evolución que nos llevará hasta la era de los 0.2 nm hacia el año 2046.
IMEC pronostica cuando llegaran los chips sub-1 nm
Según este cronograma, el avance se dividirá en tres grandes eras tecnológicas. Actualmente, nos encontramos en la era de los transistores nanosheets, una tecnología que continuará perfeccionándose hasta aproximadamente 2031. Esta etapa es la base de los procesadores actuales y de los próximos nodos de sub-2 nm, manteniendo vivo el legado de la Ley de Moore mediante una mayor densidad y eficiencia.
El salto ocurrirá a partir de 2034, marcando el inicio de la era de los CFET (Complementary FET). Estos dispositivos apilan verticalmente los nanosheets, permitiendo una reducción del área ocupada y un aumento de la densidad de transistores de hasta un 80 %. Es en este punto, alrededor de 2034, cuando veremos la llegada comercial de las primeras arquitecturas por debajo de 1 nm (A7 o 0.7 nm).
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La frontera final, proyectada para el periodo 2043-2046, es la era de los FET 2D. Aquí, los fabricantes utilizarán materiales con un espesor atómico para formar canales de conducción ultra delgados. Este avance permitirá alcanzar nodos de A2 (0.2 nm) y continuar escalando hacia tecnologías aún menores.
Es importante destacar que estas fechas no garantizan una producción en masa inmediata, sino que marcan la madurez de estos nodos en la investigación y el desarrollo. La transición requerirá innovaciones importantes, como el uso de rutenio en la metalización y nuevas técnicas de fabricación. En definitiva, aunque el ritmo de miniaturización de los chips se ha ralentizado, la combinación de nuevos materiales, arquitectura 3D y apilamiento vertical asegura que la potencia de cómputo continuará creciendo durante las próximas dos décadas. Os mantendremos informados.